IBM POWER
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Der IBM POWER (Performance optimized with enhanced RISC) ist der Urvater und der Großrechnerzweig der PowerPC-CPU von IBM. Er kommt (bis POWER4+) in den iSeries, ehemals AS/400, den pSeries, ehemals RS/6000, und inzwischen mit POWER5-Prozessoren in den Systemen IBM eServer p5 und eServer i5 zum Einsatz.
Aus der ursprünglichen POWER-Familie wurde zunächst der Ein-Chip-Prozessor PowerPC 601 abgewandelt, später der PowerPC 970 aus dem Power 4+. Dadurch konnte die POWER-Architektur leichter in den Workstation-, eingebetteten und im Raumfahrt-Bereichen verwendet werden.
1993 - IBM POWER2
1996 - IBM POWER2 SC SuperChip: erster Power-Prozessor aus einem Chip, vorher wurden noch acht benötigt, wurde noch bis 1999 verkauft.
1998 - IBM POWER3 64 Bit CMOS6S2 225 mm² 225M T Processor
2001 - IBM POWER4 180 nm 1,1-1,3 GHz Dual-Core
Computer-Revolution im Oktober 2001: Die IBM p690, genannt Regatta, realisierte erstmals auf einem Chip zwei CPU-Kerne, einen gemeinsamen L2 Cache und eine sehr schnelle Switch-Schnittstelle. Aber auch die Verbindungs-Schnittstellen dieser Chips waren neuartig. So wurden vier dieser Micro-Chips auf einem gemeinsamen Multi-Chip-Modul MCM verbunden, und IBM erreichte damit die extrem hohe Packungsdichte von acht CPUs auf einer Fläche von 90 cm². Die Regatta erreichte mit 32 CPUs eine Spitzenleistung von über 1 Mio tpm-C (März 2004). tpm-C kann man sich als Datenbank-Benchmark vorstellen.
2002 - IBM POWER4+ 130 nm 1,2-1,9 GHz Dual-Core-Prozessor 267 mm² 185M T, welcher unter anderem in den Regatta (RS/6000 oder pSeries)-Servern bis 32 CPU SMP verwendet wird.
2004 - IBM POWER5 130 nm 1,5; 1,65; 1,9 GHz Dual-Core 389 mm² 276M T mit Simultaneous Multi-Threading SMT und integriertem Speichercontroller. Cache: Instruction: 64k2w-lru Data: 32k4w-lru L2: 1.92m10w-lru. in partitionierbaren pSeries und iSeries SMP-Servern von 1 bis 64 CPUs, 1 GB-2 TB Hauptspeicher und 5-240 PCI-X-Slots. Ein Multi-Chip-Module mit vier Chips (also acht Kernen) und 36 MB L3-Cache besteht aus 89 Metallagen mit insgesamt 5.370 I/O-Pins, von denen 2.313 Signalpins sind und 3.057 für die Energiezufuhr benötigt werden.
POWER5 ist die Weiterentwicklung von POWER4. Zusätzlich zur POWER4-Architektur befindet sich auf dem Chip das L3-Directory und der Memory-Controller, dazu kommt eine höhere Taktung. POWER5 ist bis zu dreimal leistungsfähiger als POWER4. IBM behauptet, dass dieses für die derzeit beste Skalierbarkeit (linear bis 64 Wege) aller am Markt angebotenen Server sorgt. Dieses ist glaubwürdig, weil weder Dell, SUN oder HP derzeit in der Lage sind, leistungsfähigere/schnellere Systeme als die IBM-POWER4-basierten Server zu bieten, die zum Beispiel bereits 50 % geringeren Strombedarf als ihre Wettbewerbssysteme aufweisen. Technisch gesehen spielen POWER5-Systeme zur Zeit in einer eigenen Liga, insbesondere in der ausgereiften Mainframe-Flexibilität (granulare Virtualisierung und automatische Lastverteilung im laufenden Betrieb zwischen den Partitionen im Bereich von einem hundertstel einer CPU, und das passiert im Millisekundenbereich).
4. Oktober 2005 - Ankündigung IBM POWER5+ 90 nm Quad-Core
2007(erwartet): IBM POWER6 65 nm
